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Stage - Ingénieur R&D - Déploiement d'IA Embarquée sur Fpga H/F Groupe SII

  • Toulouse - 31
  • Stage
  • Bac +5
  • Secteur informatique • ESN
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À noter sur ce job

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Détail du poste

Profil

Élève ingénieur en dernière année avec une spécialisation en systèmes embarqués, électronique numérique, informatique industrielle ou IA embarquée. Vous possédez de bonnes compétences en développement logiciel et un intérêt marqué pour les architectures FPGA. Des connaissances en Linux embarqué, traitement d'images ou déploiement de modèles de détection d'objets constituent un atout. Vous êtes autonome, rigoureux(se) et motivé(e) par les défis techniques de R&D.

Mission

Contexte :

Au sein du Pôle R&D, vous rejoignez l'équipe ASPERA qui travaille sur des solutions pour le guidage autonome de satellite afin d'effectuer des opérations de services en orbite pour optimiser le cycle de vie ainsi que la ré-usabilité des équipements. Cette navigation autonome repose notamment sur un modèle de détection d'objets de type YOLO, aujourd'hui déployé sur les calculateurs embarqués du démonstrateur ASPERA.

Objectifs de la mission :

AMD/Xilinx Versal est une nouvelle génération de SoC adaptatif combinant logique programmable (FPGA), coeurs de traitement et moteurs dédiés à l'IA (AI Engines). Cette architecture hétérogène ouvre la voie à des gains significatifs de performance et d'efficacité énergétique pour l'inférence de modèles d'IA embarqués, par rapport aux calculateurs de type MPSoC actuellement utilisés sur les démonstrateurs ASPERA. Vous explorerez le potentiel de la technologie Versal AI Edge pour l'embarqué spatial, en portant sur cette nouvelle cible le modèle de détection YOLO actuellement utilisé par ASPERA. Les travaux visent à évaluer et optimiser les performances de ce modèle sur les AI Engines de Versal, et à poser les bases d'une méthodologie de déploiement réutilisable pour les futurs projets de l'équipe.

Dans le cadre de ce stage, vous serez amené(e) à :

Prendre en main l'environnement de développement Versal (Vitis, Vivado, AI Engine Tools)

Porter et optimiser le modèle YOLO utilisé par ASPERA sur l'architecture AMD/Xilinx Versal AI Edge

Comparer les performances (latence, précision, consommation) entre l'implémentation actuelle sur DPU/MPSoC et la nouvelle cible Versal

Contribuer à une méthodologie d'intégration réutilisable, comprenant prétraitement, inférence sur AI Engine et post traitement.

Groupe SII

Qui sommes-nous ?

Le groupe SII est au coeur de l'innovation au service de grands comptes dans des secteurs d'ingénierie variés. En 2026, pour la 9ème année consécutive, SII France a obtenu le label Great Place To Work®.

Ce succès est le reflet de notre culture basée sur notre volonté de proposer à tous nos salariés un cadre de travail épanouissant pour le développement de leurs compétences et carrières.

Rejoindre SII, c'est s'engager dans une aventure collective : Let's Tech Together !

Cette promesse représente notre ambition commune : construire un futur technologique ensemble, dans un cadre où l'expérimentation et l'autonomie sont encouragées, où les innovations sont au coeur de nos actions, et où chaque collaborateur trouve épanouissement professionnel et responsabilisation au sein d'un collectif enthousiaste et inclusif.

En tant que société à fortes valeurs humaines, nous sommes signataires de la Charte d'engagement LGBT+ avec l'Association l'autre Cercle et sommes une entreprise Handi-accueillante.

Let's Tech Together incarne ce que nous sommes et ce que nous aspirons à être : une entreprise dynamique, innovante et humaine. Alors si ces valeurs vous parlent, rejoignez-nous !

Le profil recherché

Compétences requises : .

FPGA

Avantages : .

Meal vouchers, Très bon CSE
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Publiée le 22/10/2026 - Réf : TLS/DST/STS/R&DVERSAL

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